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Thema: logic analyzer

Hybrid-Darstellung

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  1. #1
    Erfahrener Benutzer Robotik Einstein Avatar von Vitis
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    ja, hast Recht Besserwessi ....

    Vcc an den Bockkondensatoren besser durch die Pads senkrecht durch, die Kondensatoren näher an die DuKos,
    Die position von C36 C16 C17 C40 zu den Pads
    C14 und der daneben auseinander ziehen an die DuKos
    C55 ans Pad von IC ... ist das 6 oder 9?
    C54 ?

    Bauteile in 45°-Winkel kann bei Serienfertigung Probleme bei der AOI geben, hatt ich bei nem Projektchen, dass der Bestücker das abgelehnt hat.

    Eine kurze Anbindung auch von der Versorgung hin zur VCC Seite der Kondensatoren ist nicht nötig und nicht mal unbedingt wünschenswert.
    Das kommt auf den Resr und Lesr der Kondensatoren an
    Geändert von Vitis (04.11.2011 um 10:21 Uhr)
    Vor den Erfolg haben die Götter den Schweiß gesetzt

  2. #2
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    Es ist eigentlich genug platz da, um die Stützkondensatoren auf die Seite mit den ICs zu platzieren. Nur beim großen Chip könnte es knapp werde. Da sollte man dann aber unter dem Chip keine Kompromisse mehr machen.

    Bevor man so eine große Platine aufbaut, würde ich erst mal im kleinen testen ob die Pegelwandlung denn so geht. Was wurde denn da als Pegelwandler genommen ? Mit den vielen kleinen ICs sieht komisch aus, und da ist auch nicht klar wie es mit der Versorgung aussieht. So viele kleine ICs als Pegelwandler sind schon komisch.

  3. #3
    Erfahrener Benutzer Robotik Einstein Avatar von Vitis
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    Die vielen kleinen SOT-23 müssten sowas da sein:
    http://www.nxp.com/documents/data_sh...XS2UAT_SER.pdf

    und als Pegelwandler:
    MAX964 http://www.maxim-ic.com/datasheet/index.mvp/id/1481
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  4. #4
    Erfahrener Benutzer Robotik Visionär
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    Die genannten Schutzdioden geben einen guten Schutz, aber auch recht viel Kapazität. Je nach Version die man da hat, bräuchte man dahinter dann gar keine so schnellen Teile mehr.

    Die Komperatoren sehen schon gut aus, die Frage war nach den 5 poligen ICs zwischen den Komparatoren und dem FPGA. Da hätte ich eher ICs für je 8 Kanäle erwartet, etwa 74LVX...oder ähnlich mit 5 V toleranten Eingängen.

  5. #5
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    Hallo,

    Danke für eure Kritik. Ich bin momentan auch dabei eure Vorschläge einzuarbeiten. Ich lege alle Stützkondensatoren direkt an die Pins auf das selbe Layer (sofern möglich).
    Es ist eigentlich genug platz da, um die Stützkondensatoren auf die Seite mit den ICs zu platzieren. Nur beim großen Chip könnte es knapp werde. Da sollte man dann aber unter dem Chip keine Kompromisse mehr machen.
    Was meinst du mit "keine Kompromisse mehr machen" genau, Besserwessi? Direkt an die Pins Vias und direkt drunter die Stützkondensatoren? Dann muss ich wohl die Leitungen unter dem FGPA nommal aufmachen.

    Am Eingang sind Schutzdioden Typ BAS70-04:
    http://www.datasheetcatalog.org/data.../179837_DS.pdf

    Die haben eine recht kleine Kapazität, sonst geht ja meine Geschwindigkeit flöten.

    Dann kommen Komperatoren MAX964:
    http://www.maxim-ic.com/datasheet/index.mvp/id/1481

    Zur Pegelwandlung verwende ich ein schnelles UND Gatter NC7SZ08:
    http://www.fairchildsemi.com/ds/NC/NC7SZ08.pdf

    Den Schaltplan hab ich auch auf Seite 2 schon gepostet, wenn ihr es genauers wissen wollt.

    Grüße,
    hacker
    Ich würde ja gern die Welt verändern..., doch Gott gibt mir den Quellcode nicht!

  6. #6
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    Die BAS70 als Dioden sollten natürlich gehen. Die von Vitis verlinkten Schutzdioden wären aber mit 50-100 pF Kapazität ein Problem.
    Bei den Gattern als Pegelwandler wundere ich mich, ob es da nicht passendere gibt: schon einfach 2 Inverter in einem IC wäre ein Fortschritt. Es gibt sicher auch gleich 4 und 8 Bit in einem IC.

    Wenn beim FPGA die Kondensatoren auf die Unterseite kommen, sollte dann der Rest stimmen: also eine Masseebene die den Namen verdient hat, also keine längeren Schlitze hat. Wie die Zuführung von VCC geschieht ist dagegen nebensächlich. Das darf auch einmal außen herum. Ganz so extrem mit den Kondensatoren direkt auf die Vias muss es nicht sein, aber mehr als ein paar mm sollten für die Leitung nicht nötig sein. Vor allem der Weg zurück unter den Chip ist dabei nicht unbedingt negativ weil die Bahn da parallel zu der Im Chip verläuft. So wie ich das sehe ist das nicht ganz einfach mit dem Layout unter dem FPGA.

  7. #7
    Erfahrener Benutzer Roboter Genie
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    Hallo,

    hier mal ein aktualisiertes Layout (zwei Leiterbahnen fehlen noch). Ich denke, das unter dem FPGA hab ich ganz gut hin bekommen:

    Klicke auf die Grafik für eine größere Ansicht

Name:	layout_bottom.jpg
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    Klicke auf die Grafik für eine größere Ansicht

Name:	layout_top.jpg
Hits:	23
Größe:	125,2 KB
ID:	20486

    Bei den Gattern als Pegelwandler gibt es sicherlich noch andere schnelle. Aber über die bin ich gestoßen und dann hab ich nicht mehr wirklich weiter gesucht. So schlimm vom Layout her find ich die einzelnen jetzt aber auch nicht. Ist nachher viellleicht mehr Lötaufwand.
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